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简单线性快速加法器
本公开披露的是一种基于作者对数学、自然数和实数的新颖公理化设计出的快速加法器加法(addition)是一个平均需要1og2n次迭代来计算一个n位加法的有限状态机。此外,对于此快速加法器,一个n位加法需要k≤n次迭代才能...
J·P·拉米雷斯
加法器、运算电路、芯片和计算装置
本公开涉及加法器、运算电路、芯片和计算装置。公开了一种加法器,用于计算输入的两个数字之和,加法器具有分别表示两个数字的两个输入,每个输入被彼此对应地划分为多个子部分,多个子部分由低位到高位依次表示输入的部分位,加法器包括...
刘建波范志军李楠郭海丰
基于原理图输入的补码加法器设计
2025年
作为电子设计自动化技术,EDA利用计算机及相应的工具软件,完成包括电子电路、PCB印刷电路板,以及集成电路的设计、综合、仿真验证等工作;随着集成电路技术与计算机技术的发展,EDA技术得到快速发展,具备了自动化设计能力;Quartus II是一个广泛应用的EDA开发平台;文章在Quartus II平台,用原理图输入的方式,设计了全加器,并进一步设计实现了三位补码加法器
罗海涛
关键词:EDA全加器
一种基于忆阻的一位二进制加法器电路
本申请提供一种基于忆阻的一位二进制加法器电路,包括:多个与门,或门以及互补金属氧化物半导体反相器,多个所述与门以及或门是基于忆阻的,通过将相应的互补金属氧化物半导体反相器,与相应的与门、或门以及电路的输入输出端点相连接,...
顾海林胡畔王丽霞李伟冉冉高强刘晓强刘育博崔益军周俊
33位加法器及其实现方法、运算电路及芯片
本申请实施例提供了一种33位加法器及其实现方法、运算电路和芯片,该33位加法器包括N个进位模块和求和模块;每个进位模块对应第一加数和第二加数中的多个比特位,且包括预处理单元和多个进位计算单元;第n个进位模块包含的预处理单...
请求不公布姓名请求不公布姓名
加法器及数据运算方法、存储器及电子设备
本申请涉及一种加法器及数据运算方法、存储器及电子设备,属于电子电路领域。加法器包括:控制模块和多个运算模块,每个运算模块包含第一锁存器、第二锁存器、第一选择电路;第一锁存器,用于存储加数与被加数相加的进位值;第二锁存器用...
黄瑞锋
实用模电速成:常见电路 加法器和减法器
2025年
在全国大学生电子设计竞赛(以下简称电赛)题目中,加法器和减法器出现频率很高。虽然它们很简单,但仍需要引起重视。
杨建国
关键词:全国大学生电子设计竞赛减法器加法器
感知器神经网络加法器的理论研究与设计
2025年
加法器作为数字电路中的核心组件,其运算效率对处理器的整体性能起着至关重要的作用。针对传统加法器存在的效率和延迟方面的瓶颈,文章提出一种基于感知器神经网络的加法器设计方法。首先提出一种全连接的网络结构并设计基于该网络的布尔函数实现算法,然后通过分析加法器的逻辑需求,设计“和”与“进位”功能的网络结构,最终构建出具备完整功能的感知器神经网络加法器架构。实验结果表明,基于感知神经网络的电路设计方法不仅具有可行性,还可以进一步推广应用于一般的逻辑电路设计领域。
徐陈靖贺勤斌
关键词:神经网络感知器加法器电路设计
近似加法器树设计方法、加法器树电路结构以及芯片
本发明公开近似加法器树设计方法、加法器树电路结构以及芯片,涉及芯片技术领域。具体包括通过依次交替设置的或电路结构和或、与电路结构对输入数据进行初步近似运算;在第二层中,交替设有用于将第一层的进位结果保留,并与当前层的结果...
潘彪张涵薛震宇易文特张悦
支持存内计算的存储器、存储单元阵列和级联加法器
本申请实施例提供一种支持存内计算的存储器、存储阵列和级联加法器,包括:存储单元阵列以及被存储单元阵列中同一列上的存储单元共用的读写单元和位线。其中,一列存储单元划分为多组,并且一列存储单元共用的同一位线设置有多组存储单元...
贾天宇贺思远

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刘伟强
作品数:170被引量:34H指数:3
供职机构:南京航空航天大学
研究主题:电路 乘法器 逐次逼近型 乘法 流水线
周婉婷
作品数:89被引量:23H指数:3
供职机构:电子科技大学
研究主题:加法器 乘法器 反相器 二进制 处理器
李磊
作品数:142被引量:20H指数:2
供职机构:电子科技大学
研究主题:加法器 乘法器 反相器 二进制 处理器
李艳
作品数:50被引量:19H指数:1
供职机构:河北工业大学
研究主题:除法器 除数 二进制 加法器 数字信号处理系统
武金木
作品数:45被引量:19H指数:1
供职机构:河北工业大学计算机科学与软件学院
研究主题:除法器 除数 二进制 加法器 数字信号处理系统